tcg-ppc64: Implement mulu2/muls2_i64
Reviewed-by: Aurelien Jarno <aurelien@aurel32.net> Signed-off-by: Richard Henderson <rth@twiddle.net>
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6c858762de
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6645c147db
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@ -1988,6 +1988,31 @@ static void tcg_out_op (TCGContext *s, TCGOpcode opc, const TCGArg *args,
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}
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}
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break;
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break;
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case INDEX_op_mulu2_i64:
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case INDEX_op_muls2_i64:
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{
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int oph = (opc == INDEX_op_mulu2_i64 ? MULHDU : MULHD);
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TCGReg outl = args[0], outh = args[1];
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a0 = args[2], a1 = args[3];
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if (outl == a0 || outl == a1) {
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if (outh == a0 || outh == a1) {
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outl = TCG_REG_R0;
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} else {
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tcg_out32(s, oph | TAB(outh, a0, a1));
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oph = 0;
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}
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}
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tcg_out32(s, MULLD | TAB(outl, a0, a1));
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if (oph != 0) {
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tcg_out32(s, oph | TAB(outh, a0, a1));
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}
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if (outl != args[0]) {
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tcg_out_mov(s, TCG_TYPE_I64, args[0], outl);
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}
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}
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break;
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default:
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default:
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tcg_dump_ops (s);
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tcg_dump_ops (s);
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tcg_abort ();
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tcg_abort ();
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@ -2116,6 +2141,8 @@ static const TCGTargetOpDef ppc_op_defs[] = {
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{ INDEX_op_add2_i64, { "r", "r", "r", "rI", "r", "rZM" } },
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{ INDEX_op_add2_i64, { "r", "r", "r", "rI", "r", "rZM" } },
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||||||
{ INDEX_op_sub2_i64, { "r", "r", "rI", "r", "rZM", "r" } },
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{ INDEX_op_sub2_i64, { "r", "r", "rI", "r", "rZM", "r" } },
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||||||
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{ INDEX_op_muls2_i64, { "r", "r", "r", "r" } },
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{ INDEX_op_mulu2_i64, { "r", "r", "r", "r" } },
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{ -1 },
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{ -1 },
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};
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};
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@ -114,8 +114,8 @@ typedef enum {
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#define TCG_TARGET_HAS_movcond_i64 1
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#define TCG_TARGET_HAS_movcond_i64 1
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#define TCG_TARGET_HAS_add2_i64 1
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#define TCG_TARGET_HAS_add2_i64 1
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||||||
#define TCG_TARGET_HAS_sub2_i64 1
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#define TCG_TARGET_HAS_sub2_i64 1
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||||||
#define TCG_TARGET_HAS_mulu2_i64 0
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#define TCG_TARGET_HAS_mulu2_i64 1
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||||||
#define TCG_TARGET_HAS_muls2_i64 0
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#define TCG_TARGET_HAS_muls2_i64 1
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||||||
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#define TCG_AREG0 TCG_REG_R27
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#define TCG_AREG0 TCG_REG_R27
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