target/arm: Convert Neon 2-reg-scalar VQRDMLAH, VQRDMLSH to decodetree
Convert the VQRDMLAH and VQRDMLSH insns in the 2-reg-scalar group to decodetree. Signed-off-by: Peter Maydell <peter.maydell@linaro.org> Reviewed-by: Richard Henderson <richard.henderson@linaro.org>
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aa318f5b9b
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@ -488,5 +488,8 @@ Vimm_1r 1111 001 . 1 . 000 ... .... cmode:4 0 . op:1 1 .... @1reg_imm
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VQDMULH_2sc 1111 001 . 1 . .. .... .... 1100 . 1 . 0 .... @2scalar
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VQDMULH_2sc 1111 001 . 1 . .. .... .... 1100 . 1 . 0 .... @2scalar
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VQRDMULH_2sc 1111 001 . 1 . .. .... .... 1101 . 1 . 0 .... @2scalar
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VQRDMULH_2sc 1111 001 . 1 . .. .... .... 1101 . 1 . 0 .... @2scalar
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VQRDMLAH_2sc 1111 001 . 1 . .. .... .... 1110 . 1 . 0 .... @2scalar
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VQRDMLSH_2sc 1111 001 . 1 . .. .... .... 1111 . 1 . 0 .... @2scalar
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]
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]
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}
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}
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@ -2575,3 +2575,77 @@ static bool trans_VQRDMULH_2sc(DisasContext *s, arg_2scalar *a)
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return do_2scalar(s, a, opfn[a->size], NULL);
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return do_2scalar(s, a, opfn[a->size], NULL);
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}
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}
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static bool do_vqrdmlah_2sc(DisasContext *s, arg_2scalar *a,
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NeonGenThreeOpEnvFn *opfn)
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{
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/*
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* VQRDMLAH/VQRDMLSH: this is like do_2scalar, but the opfn
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* performs a kind of fused op-then-accumulate using a helper
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* function that takes all of rd, rn and the scalar at once.
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*/
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TCGv_i32 scalar;
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int pass;
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if (!arm_dc_feature(s, ARM_FEATURE_NEON)) {
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return false;
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}
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if (!dc_isar_feature(aa32_rdm, s)) {
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return false;
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}
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/* UNDEF accesses to D16-D31 if they don't exist. */
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if (!dc_isar_feature(aa32_simd_r32, s) &&
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((a->vd | a->vn | a->vm) & 0x10)) {
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return false;
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}
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if (!opfn) {
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/* Bad size (including size == 3, which is a different insn group) */
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return false;
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}
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if (a->q && ((a->vd | a->vn) & 1)) {
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return false;
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}
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if (!vfp_access_check(s)) {
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return true;
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}
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scalar = neon_get_scalar(a->size, a->vm);
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for (pass = 0; pass < (a->q ? 4 : 2); pass++) {
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TCGv_i32 rn = neon_load_reg(a->vn, pass);
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TCGv_i32 rd = neon_load_reg(a->vd, pass);
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opfn(rd, cpu_env, rn, scalar, rd);
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tcg_temp_free_i32(rn);
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neon_store_reg(a->vd, pass, rd);
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}
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tcg_temp_free_i32(scalar);
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return true;
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}
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static bool trans_VQRDMLAH_2sc(DisasContext *s, arg_2scalar *a)
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{
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static NeonGenThreeOpEnvFn *opfn[] = {
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NULL,
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gen_helper_neon_qrdmlah_s16,
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gen_helper_neon_qrdmlah_s32,
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NULL,
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};
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return do_vqrdmlah_2sc(s, a, opfn[a->size]);
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}
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static bool trans_VQRDMLSH_2sc(DisasContext *s, arg_2scalar *a)
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{
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static NeonGenThreeOpEnvFn *opfn[] = {
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||||||
|
NULL,
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||||||
|
gen_helper_neon_qrdmlsh_s16,
|
||||||
|
gen_helper_neon_qrdmlsh_s32,
|
||||||
|
NULL,
|
||||||
|
};
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||||||
|
return do_vqrdmlah_2sc(s, a, opfn[a->size]);
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|
}
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@ -5179,6 +5179,8 @@ static int disas_neon_data_insn(DisasContext *s, uint32_t insn)
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||||||
case 9: /* Floating point VMUL scalar */
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case 9: /* Floating point VMUL scalar */
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case 12: /* VQDMULH scalar */
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case 12: /* VQDMULH scalar */
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||||||
case 13: /* VQRDMULH scalar */
|
case 13: /* VQRDMULH scalar */
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|
case 14: /* VQRDMLAH scalar */
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|
case 15: /* VQRDMLSH scalar */
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||||||
return 1; /* handled by decodetree */
|
return 1; /* handled by decodetree */
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||||||
case 3: /* VQDMLAL scalar */
|
case 3: /* VQDMLAL scalar */
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||||||
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@ -5238,42 +5240,6 @@ static int disas_neon_data_insn(DisasContext *s, uint32_t insn)
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||||||
neon_store_reg64(cpu_V0, rd + pass);
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neon_store_reg64(cpu_V0, rd + pass);
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}
|
}
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break;
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break;
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case 14: /* VQRDMLAH scalar */
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case 15: /* VQRDMLSH scalar */
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{
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NeonGenThreeOpEnvFn *fn;
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if (!dc_isar_feature(aa32_rdm, s)) {
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return 1;
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}
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if (u && ((rd | rn) & 1)) {
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return 1;
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}
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if (op == 14) {
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if (size == 1) {
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fn = gen_helper_neon_qrdmlah_s16;
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} else {
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fn = gen_helper_neon_qrdmlah_s32;
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}
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||||||
} else {
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||||||
if (size == 1) {
|
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||||||
fn = gen_helper_neon_qrdmlsh_s16;
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} else {
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||||||
fn = gen_helper_neon_qrdmlsh_s32;
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}
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}
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tmp2 = neon_get_scalar(size, rm);
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for (pass = 0; pass < (u ? 4 : 2); pass++) {
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tmp = neon_load_reg(rn, pass);
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tmp3 = neon_load_reg(rd, pass);
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fn(tmp, cpu_env, tmp, tmp2, tmp3);
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tcg_temp_free_i32(tmp3);
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||||||
neon_store_reg(rd, pass, tmp);
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}
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||||||
tcg_temp_free_i32(tmp2);
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||||||
}
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||||||
break;
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||||||
default:
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default:
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g_assert_not_reached();
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g_assert_not_reached();
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}
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}
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