target-ppc: add altivec cache instructions
Signed-off-by: Aurelien Jarno <aurelien@aurel32.net> git-svn-id: svn://svn.savannah.nongnu.org/qemu/trunk@6275 c046a42c-6fe2-441c-8c8c-71466251a162
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afdf8109e3
commit
ae1c1a3d68
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@ -4152,6 +4152,33 @@ GEN_HANDLER2(dcbz_970, "dcbz", 0x1F, 0x16, 0x1F, 0x03C00001, PPC_CACHE_DCBZT)
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tcg_temp_free(t0);
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tcg_temp_free(t0);
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}
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}
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/* dst / dstt */
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GEN_HANDLER(dst, 0x1F, 0x16, 0x0A, 0x01800001, PPC_ALTIVEC)
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{
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if (rA(ctx->opcode) == 0) {
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gen_inval_exception(ctx, POWERPC_EXCP_INVAL_LSWX);
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} else {
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/* interpreted as no-op */
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}
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}
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/* dstst /dststt */
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GEN_HANDLER(dstst, 0x1F, 0x16, 0x0B, 0x02000001, PPC_ALTIVEC)
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{
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if (rA(ctx->opcode) == 0) {
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gen_inval_exception(ctx, POWERPC_EXCP_INVAL_LSWX);
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} else {
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/* interpreted as no-op */
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}
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}
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/* dss / dssall */
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GEN_HANDLER(dss, 0x1F, 0x16, 0x19, 0x019FF801, PPC_ALTIVEC)
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{
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/* interpreted as no-op */
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}
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/* icbi */
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/* icbi */
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GEN_HANDLER(icbi, 0x1F, 0x16, 0x1E, 0x03E00001, PPC_CACHE_ICBI)
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GEN_HANDLER(icbi, 0x1F, 0x16, 0x1E, 0x03E00001, PPC_CACHE_ICBI)
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{
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{
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