ppc: Speed up dcbz
Use tlb_vaddr_to_host to do a fast path single translate for the whole cache line. Also make the reservation check match the entire range. Signed-off-by: Benjamin Herrenschmidt <benh@kernel.crashing.org> Signed-off-by: David Gibson <david@gibson.dropbear.id.au>
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22b56ee568
commit
c9f82d013b
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@ -141,35 +141,39 @@ void helper_stsw(CPUPPCState *env, target_ulong addr, uint32_t nb,
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}
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}
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}
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}
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static void do_dcbz(CPUPPCState *env, target_ulong addr, int dcache_line_size,
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void helper_dcbz(CPUPPCState *env, target_ulong addr, uint32_t opcode)
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uintptr_t raddr)
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{
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{
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int i;
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target_ulong mask, dcbz_size = env->dcache_line_size;
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uint32_t i;
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addr &= ~(dcache_line_size - 1);
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void *haddr;
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for (i = 0; i < dcache_line_size; i += 4) {
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cpu_stl_data_ra(env, addr + i, 0, raddr);
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}
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if (env->reserve_addr == addr) {
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env->reserve_addr = (target_ulong)-1ULL;
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}
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}
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void helper_dcbz(CPUPPCState *env, target_ulong addr, uint32_t is_dcbzl)
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{
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int dcbz_size = env->dcache_line_size;
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#if defined(TARGET_PPC64)
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#if defined(TARGET_PPC64)
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if (!is_dcbzl &&
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/* Check for dcbz vs dcbzl on 970 */
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(env->excp_model == POWERPC_EXCP_970) &&
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if (env->excp_model == POWERPC_EXCP_970 &&
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((env->spr[SPR_970_HID5] >> 7) & 0x3) == 1) {
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!(opcode & 0x00200000) && ((env->spr[SPR_970_HID5] >> 7) & 0x3) == 1) {
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dcbz_size = 32;
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dcbz_size = 32;
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}
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}
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#endif
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#endif
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/* XXX add e500mc support */
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/* Align address */
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mask = ~(dcbz_size - 1);
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addr &= mask;
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do_dcbz(env, addr, dcbz_size, GETPC());
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/* Check reservation */
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if ((env->reserve_addr & mask) == (addr & mask)) {
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env->reserve_addr = (target_ulong)-1ULL;
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}
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/* Try fast path translate */
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haddr = tlb_vaddr_to_host(env, addr, MMU_DATA_STORE, env->dmmu_idx);
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if (haddr) {
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memset(haddr, 0, dcbz_size);
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} else {
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/* Slow path */
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for (i = 0; i < dcbz_size; i += 8) {
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cpu_stq_data_ra(env, addr + i, 0, GETPC());
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}
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}
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}
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}
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void helper_icbi(CPUPPCState *env, target_ulong addr)
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void helper_icbi(CPUPPCState *env, target_ulong addr)
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@ -4088,18 +4088,15 @@ static void gen_dcbtls(DisasContext *ctx)
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static void gen_dcbz(DisasContext *ctx)
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static void gen_dcbz(DisasContext *ctx)
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{
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{
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TCGv tcgv_addr;
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TCGv tcgv_addr;
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TCGv_i32 tcgv_is_dcbzl;
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TCGv_i32 tcgv_op;
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int is_dcbzl = ctx->opcode & 0x00200000 ? 1 : 0;
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gen_set_access_type(ctx, ACCESS_CACHE);
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gen_set_access_type(ctx, ACCESS_CACHE);
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tcgv_addr = tcg_temp_new();
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tcgv_addr = tcg_temp_new();
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tcgv_is_dcbzl = tcg_const_i32(is_dcbzl);
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tcgv_op = tcg_const_i32(ctx->opcode & 0x03FF000);
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gen_addr_reg_index(ctx, tcgv_addr);
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gen_addr_reg_index(ctx, tcgv_addr);
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gen_helper_dcbz(cpu_env, tcgv_addr, tcgv_is_dcbzl);
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gen_helper_dcbz(cpu_env, tcgv_addr, tcgv_op);
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||||||
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tcg_temp_free(tcgv_addr);
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tcg_temp_free(tcgv_addr);
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tcg_temp_free_i32(tcgv_is_dcbzl);
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tcg_temp_free_i32(tcgv_op);
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}
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}
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/* dst / dstt */
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/* dst / dstt */
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