target/arm: Implement SVE2 bitwise shift and insert
Reviewed-by: Peter Maydell <peter.maydell@linaro.org> Signed-off-by: Richard Henderson <richard.henderson@linaro.org> Message-id: 20210525010358.152808-23-richard.henderson@linaro.org Signed-off-by: Peter Maydell <peter.maydell@linaro.org>
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fc12b46a46
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@ -1261,3 +1261,8 @@ SSRA 01000101 .. 0 ..... 1110 00 ..... ..... @rd_rn_tszimm_shr
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USRA 01000101 .. 0 ..... 1110 01 ..... ..... @rd_rn_tszimm_shr
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USRA 01000101 .. 0 ..... 1110 01 ..... ..... @rd_rn_tszimm_shr
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SRSRA 01000101 .. 0 ..... 1110 10 ..... ..... @rd_rn_tszimm_shr
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SRSRA 01000101 .. 0 ..... 1110 10 ..... ..... @rd_rn_tszimm_shr
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URSRA 01000101 .. 0 ..... 1110 11 ..... ..... @rd_rn_tszimm_shr
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URSRA 01000101 .. 0 ..... 1110 11 ..... ..... @rd_rn_tszimm_shr
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## SVE2 bitwise shift and insert
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SRI 01000101 .. 0 ..... 11110 0 ..... ..... @rd_rn_tszimm_shr
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SLI 01000101 .. 0 ..... 11110 1 ..... ..... @rd_rn_tszimm_shl
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@ -6428,3 +6428,13 @@ static bool trans_URSRA(DisasContext *s, arg_rri_esz *a)
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{
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{
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return do_sve2_fn2i(s, a, gen_gvec_ursra);
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return do_sve2_fn2i(s, a, gen_gvec_ursra);
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}
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}
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static bool trans_SRI(DisasContext *s, arg_rri_esz *a)
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{
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return do_sve2_fn2i(s, a, gen_gvec_sri);
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}
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static bool trans_SLI(DisasContext *s, arg_rri_esz *a)
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{
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return do_sve2_fn2i(s, a, gen_gvec_sli);
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}
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