target/arm: Convert VMOV (imm) to decodetree
Convert the VFP VMOV (immediate) instruction to decodetree. Signed-off-by: Peter Maydell <peter.maydell@linaro.org> Reviewed-by: Richard Henderson <richard.henderson@linaro.org>
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b518c753f0
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@ -1602,3 +1602,132 @@ static bool trans_VFM_dp(DisasContext *s, arg_VFM_sp *a)
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return true;
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}
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static bool trans_VMOV_imm_sp(DisasContext *s, arg_VMOV_imm_sp *a)
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{
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uint32_t delta_d = 0;
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uint32_t bank_mask = 0;
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int veclen = s->vec_len;
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TCGv_i32 fd;
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uint32_t n, i, vd;
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vd = a->vd;
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if (!dc_isar_feature(aa32_fpshvec, s) &&
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(veclen != 0 || s->vec_stride != 0)) {
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return false;
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}
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if (!arm_dc_feature(s, ARM_FEATURE_VFP3)) {
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return false;
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}
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if (!vfp_access_check(s)) {
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return true;
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}
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if (veclen > 0) {
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bank_mask = 0x18;
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/* Figure out what type of vector operation this is. */
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if ((vd & bank_mask) == 0) {
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/* scalar */
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veclen = 0;
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} else {
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delta_d = s->vec_stride + 1;
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}
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}
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n = (a->imm4h << 28) & 0x80000000;
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i = ((a->imm4h << 4) & 0x70) | a->imm4l;
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if (i & 0x40) {
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i |= 0x780;
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} else {
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i |= 0x800;
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}
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n |= i << 19;
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fd = tcg_temp_new_i32();
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tcg_gen_movi_i32(fd, n);
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for (;;) {
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neon_store_reg32(fd, vd);
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if (veclen == 0) {
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break;
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}
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/* Set up the operands for the next iteration */
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veclen--;
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vd = ((vd + delta_d) & (bank_mask - 1)) | (vd & bank_mask);
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}
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tcg_temp_free_i32(fd);
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return true;
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}
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static bool trans_VMOV_imm_dp(DisasContext *s, arg_VMOV_imm_dp *a)
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{
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uint32_t delta_d = 0;
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uint32_t bank_mask = 0;
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int veclen = s->vec_len;
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TCGv_i64 fd;
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uint32_t n, i, vd;
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vd = a->vd;
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||||
/* UNDEF accesses to D16-D31 if they don't exist. */
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if (!dc_isar_feature(aa32_fp_d32, s) && (vd & 0x10)) {
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return false;
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||||
}
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||||
if (!dc_isar_feature(aa32_fpshvec, s) &&
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(veclen != 0 || s->vec_stride != 0)) {
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return false;
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}
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if (!arm_dc_feature(s, ARM_FEATURE_VFP3)) {
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return false;
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}
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if (!vfp_access_check(s)) {
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return true;
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}
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if (veclen > 0) {
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bank_mask = 0xc;
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||||
/* Figure out what type of vector operation this is. */
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||||
if ((vd & bank_mask) == 0) {
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||||
/* scalar */
|
||||
veclen = 0;
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||||
} else {
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delta_d = (s->vec_stride >> 1) + 1;
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}
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}
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||||
n = (a->imm4h << 28) & 0x80000000;
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i = ((a->imm4h << 4) & 0x70) | a->imm4l;
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||||
if (i & 0x40) {
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||||
i |= 0x3f80;
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} else {
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i |= 0x4000;
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||||
}
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n |= i << 16;
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fd = tcg_temp_new_i64();
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tcg_gen_movi_i64(fd, ((uint64_t)n) << 32);
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for (;;) {
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neon_store_reg64(fd, vd);
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if (veclen == 0) {
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break;
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}
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||||
/* Set up the operands for the next iteration */
|
||||
veclen--;
|
||||
vd = ((vd + delta_d) & (bank_mask - 1)) | (vd & bank_mask);
|
||||
}
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||||
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||||
tcg_temp_free_i64(fd);
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return true;
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||||
}
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@ -3033,7 +3033,7 @@ static void gen_neon_dup_high16(TCGv_i32 var)
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*/
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||||
static int disas_vfp_insn(DisasContext *s, uint32_t insn)
|
||||
{
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uint32_t rd, rn, rm, op, i, n, delta_d, delta_m, bank_mask;
|
||||
uint32_t rd, rn, rm, op, delta_d, delta_m, bank_mask;
|
||||
int dp, veclen;
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||||
TCGv_i32 tmp;
|
||||
TCGv_i32 tmp2;
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||||
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@ -3093,7 +3093,7 @@ static int disas_vfp_insn(DisasContext *s, uint32_t insn)
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rn = VFP_SREG_N(insn);
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switch (op) {
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case 0 ... 13:
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case 0 ... 14:
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/* Already handled by decodetree */
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return 1;
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default:
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@ -3279,29 +3279,6 @@ static int disas_vfp_insn(DisasContext *s, uint32_t insn)
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for (;;) {
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||||
/* Perform the calculation. */
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||||
switch (op) {
|
||||
case 14: /* fconst */
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||||
if (!arm_dc_feature(s, ARM_FEATURE_VFP3)) {
|
||||
return 1;
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||||
}
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||||
n = (insn << 12) & 0x80000000;
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i = ((insn >> 12) & 0x70) | (insn & 0xf);
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if (dp) {
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if (i & 0x40)
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i |= 0x3f80;
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||||
else
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||||
i |= 0x4000;
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||||
n |= i << 16;
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||||
tcg_gen_movi_i64(cpu_F0d, ((uint64_t)n) << 32);
|
||||
} else {
|
||||
if (i & 0x40)
|
||||
i |= 0x780;
|
||||
else
|
||||
i |= 0x800;
|
||||
n |= i << 19;
|
||||
tcg_gen_movi_i32(cpu_F0s, n);
|
||||
}
|
||||
break;
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||||
case 15: /* extension space */
|
||||
switch (rn) {
|
||||
case 0: /* cpy */
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@ -151,3 +151,8 @@ VFM_sp ---- 1110 1.10 .... .... 1010 . o2:1 . 0 .... \
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|||
vm=%vm_sp vn=%vn_sp vd=%vd_sp o1=2
|
||||
VFM_dp ---- 1110 1.10 .... .... 1011 . o2:1 . 0 .... \
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||||
vm=%vm_dp vn=%vn_dp vd=%vd_dp o1=2
|
||||
|
||||
VMOV_imm_sp ---- 1110 1.11 imm4h:4 .... 1010 0000 imm4l:4 \
|
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vd=%vd_sp
|
||||
VMOV_imm_dp ---- 1110 1.11 imm4h:4 .... 1011 0000 imm4l:4 \
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vd=%vd_dp
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